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AD9788提高载波采样点数

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发表于 2013-1-9 11:33 AM | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
AD9788最大8倍插值,我想载波采样点数提高到16或32个采样点,用FPGA对基带信号插值,有个
问题,FPGA输出的IQ信号不会跟9788里面的NCO生成的载波相位相同步,那么调制输出载波的相位就
不是IQ所对应的相位,没法同步吗,还是实际当中就不考滤?
9788里面的8倍插值就能跟NCO同步?
弱弱的问句,9788可用于下变频?
AD9788配置简述:x8插值;单口模式;不启用片内PLL; fDAC=50M(由9516提供)
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发表于 2013-1-9 10:31 AM | 只看该作者
目前载波4个采样点相位能对应得上,输出频率都很稳定,但将采样点数改到8个,就对应不上,按8倍插值,正好是一个周期的点数                                                                                                                                                                       
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发表于 2013-1-11 04:33 AM | 只看该作者
此贴问题编号为:1月的Q40,关于ADI论坛的说明,请参阅:/bbsdata/moniqijian/ws2si2mgnld23596.HTM。                                                                                                                                                                       

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 楼主| 发表于 2013-1-11 10:44 AM | 只看该作者
好,了解了,谢谢!                                                                                                                                                                       
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发表于 2013-1-13 08:26 AM | 只看该作者
同问啊,求解答                                                                                                                                                                       
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 楼主| 发表于 2013-1-14 06:55 AM | 只看该作者
FPGA输出的IQ信号不需要和AD9788里面的NCO生成的载波相位相同步,可根据Figure 58. Quadrature Modulator Block Diagram计算,最后就是多一个相位出来,但是频谱不变。AD9788可用于下变频,同样是这个图的计算推导                                                                                                                                                                       
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发表于 2013-1-21 06:00 AM | 只看该作者
是,您说得正是。我目前载波频率不高(只有示波器观察),载波32个点,IQ码元交替发两个相差180度的相位,从实验结果看,输出载波的相位是有偏差,但随时间往后,载波相位还不稳定,以致区分不清,实际当中这是允许的?另外,如果载波设8个采样点,我想确认片内8倍插值的7个点都是在NCO生成一个载波的周期范围内,也就是说IQ采样的数据都是在NCO的0相位,如果是这样,那么IQ所对应的相位最终就是调制载波的相位。最后,求解片内NCO能与FPGA同步不?                                                                                                                                                                       
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发表于 2013-1-21 07:43 AM | 只看该作者
你好,上面的那个问题可以解答了吗???谢谢                                                                                                                                                                       
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发表于 2013-1-21 10:10 AM | 只看该作者
前楼(第6楼)的问题编号为:1月的Q54,已经提交给ADI。                                                                                                                                                                       
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 楼主| 发表于 2013-1-21 10:58 AM | 只看该作者
建议根据Figure 58. Quadrature Modulator Block Diagram计算。片内NCO不需与FPGA发过来的数据(如果是正弦波)不需要在一个相位上。但是输入数据的时序需要满足器件手册中INPUT DATA PORTS部分的描述。                                                                                                                                                                       
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