楼主: haidongli22
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【语言求助】在学习verilog语言过程中遇到的疑问(二)

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发表于 2015-12-25 05:42 AM | 只看该作者
好帖子                                                                                                                                                                       
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发表于 2015-12-31 10:51 AM | 只看该作者
当然要加的.应该加                                                                                                                                                                       
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发表于 2015-3-18 02:37 AM | 只看该作者
为什么要加呢
就一个语句
如果不加的话也是顺序执行
不解能说必须加呢原因吗                                                                                                                                                                       
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发表于 2015-3-18 04:53 AM | 只看该作者
实际的可合成的设计中是肯定不会出现像你这样的代码的。
除非在test pattern中,而且你要实现的功能也完全不需要这样这样写。
第一,如果是要对memory进行初始化,你可以在initial中一次赋值,
其次,如果你要依时钟来对memory对应位置赋值,你可以用counter计数,
在通过counter的改变触发对memory对应位置赋值。
always@(posedge clk)
begin
if(reset)
counter<=0;
else
counter<=counter +1;
end

always @(counter)
Mem[counter]=counter;

其次,拼接符号很有用。例如:
wire A[1:0];
assign A={b[0],c[0]};
在硬件上这样的拼接也确实很有用,也很经常用。
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发表于 2015-3-18 06:52 AM | 只看该作者

提供一點意見

initial i=0 ;

always @(posedge clk)

begin

mem[i] = i ; <- 這一行不如擺至下面 i=i+1; 的上一行會更好

if (i>=1024)

begin

i=0 ; <- 這一行似乎會讓i 一直在0 ~ 1024之間循環, 不如設成 i=1024; 會更好吧

end

else

begin

mem[i] = i ; <- 上面那一行搬到這裏

i=i+1

end

end

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发表于 2015-3-18 09:00 AM | 只看该作者
我是新手.
我要编MEMORY的连续读写是不是就可以这样编写呢??32位的MEMORY.
高手们,,指点一下.小弟谢过了
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发表于 2015-3-18 11:17 AM | 只看该作者

答案:不用.

但是加了好像无妨.

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发表于 2015-3-18 01:10 PM | 只看该作者
不用加begin……end

但加了无妨
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发表于 2015-3-18 03:13 PM | 只看该作者
个人观点:

我觉得加不加都行!!!
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发表于 2015-3-18 05:31 PM | 只看该作者
if (i>=1024)

begin          // 我对这部分有点疑问这个部分用加BEGIN...END吗.

i=0 ;

end

还是加上吧。是代码风格问题,这样维护起来方便些。

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