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[原创]ADC1x13D080/JESD204A:高速ADC办理方案

2017-11-23 06:35 PM| 发布者: 噗噗东| 查看: 1488| 评论: 0

摘要: 恩智浦设计了一个USB供电的演示板,演示互操纵性Lattice的ECP3FPGA的JESD204A串行接口应用于恩智浦的ADC。由于有了在PC上运行的专用软件,USB电缆将可以为电路板提供电源,并与FPGA和ADC举行通信。它可以通过FPGA从A ...

恩智浦设计了一个USB供电的演示板,演示互操纵性Lattice的ECP3 FPGA的JESD204A串行接口应用于恩智浦的ADC。

由于有了在PC上运行的专用软件,USB电缆将可以为电路板提供电源,并与FPGA和ADC举行通信。它可以通过FPGA从ADC上加载数据,并对ADC的功能和性能举行观察(频率范围为[0;30]MHz)。通过默认板上振荡器,可以产生采样频率,但它可以选择接纳一个外部时钟,以得到更大的机动性和更好的抖动性能。

方案形貌


图1 评估板原件图(1)


图2 评估板原件图(2)


图3 评估板毗连示意图

所需要的设备列表,如下所示:

•一台PC

•一个USB电缆

•一个低抖动正弦波发生器

• 一个带通滤波器(以防正弦波纯度不敷)

• 2个SMA-SMA电缆(如果使用过滤器),如果没有过滤器则1个电缆恩智浦演示板

别的,为了驱动PC的FPGA和ADC,专用的软件是须要的。

由于LabVIEW的问世,此软件已经开辟完成,这意味着,至少在条记本电脑和LabView情况自己(V8.5)上,需要安装LabView Runtime。

在此演示板上,采样频率为默认(由板上振荡器界说,产生FS=60MHZ)。所以,可以输入一个在0Hz~30MHz之间的正弦波。虽然ADC1x13D080数据表中提到的最低频率为65MHz,但昨们决定接纳60MHz的振荡器,这是因为,与其他振荡器相比,Abracon ASE振荡器有很好的抖动性(jitter),但是,如果输出频率高于60MHZ,就不容易实现。然而,它可以体现出精良的信噪比(SNR)性能(范围72dB,[0:30] MHz频带)。

详情请复制打开此衔接地址:http://solution.eccn.com/solution_2013082713535947.htm

本文为京电港及《世界电子元器件》杂志版权所有,如转载请务必注明出处。


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